分支 · 郝玉福 / VexRiscv

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郝玉福
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formal 已合并

714d44d2 · Add fixed bug into the FormalPlugin comments · 11月 07, 2017

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spinalhdl_reworkDev 已合并

838c13d6 · spinal.core.internals literals import · 11月 10, 2017

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sim 已合并

ebda7526 · MuraxSim 1.0.0 · 12月 17, 2017

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reworkInstructionCache 已合并

8ac4d726 · Update readme · 2月 18, 2018

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Wishbone 已合并

978eb9b6 · DBusCachedPlugin add CSR info · 4月 22, 2018

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spinal_1.1.7 已合并

0476de80 · Move to SpinalHDL 1.2.0 · 9月 16, 2018

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Supervisor 已合并

905abd5a · Add wfiGenAsWait and wfiGenAsNop · 10月 16, 2018

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AHB 已合并

d2b324e3 · Add jtag and vhdl option · 4月 15, 2019

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linuxDev 已合并

3b0f2e95 · better travis timings · 4月 20, 2019

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linux 已合并

0edc781b · Add some coremark results · 4月 25, 2019

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dBusCachedRelaxMmuTranslation 已合并

91f6bf51 · Merge branch 'dBusCachedRelaxMmuTranslation' · 5月 06, 2019

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tmp 已合并

b40dc06b · SpinalHDL 1.3.5 · 5月 18, 2019

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pipelinedInterrupt 已合并

357681a5 · csrPlugin add pipelinedInterrupt, set by default · 6月 08, 2019

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rework_jump_flush 已合并

7c3c4e8c · Update readme benches · 6月 15, 2019

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cfu 已合并

d94cee13 · Add dummy decoding, exception code/tval · 9月 05, 2019

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short-pipeline-fixes 已合并

8d8c3016 · Merge branch 'short-pipeline-fixes-xobs' into short-pipeline-fixes · 9月 23, 2019

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tigthlyCoupled 已合并

5df56bea · Allow getDrivingReg to properly see i$ decode.input(INSTRUCTION) register · 10月 03, 2019

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rpls-mul16 已合并

bb926177 · Fix MulDiveIterative plugin when RSx have hazard in the execute stage · 10月 23, 2019

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masterPrerelease 已合并

390645e5 · SpinalHDL 1.3.8 · 1月 29, 2020

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compiler_plugin 已合并

d241f356 · Remove usages of implicit string to B/U/S · 2月 15, 2020

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